#ifndef _SOC_MEMORY_MAP_H
#define _SOC_MEMORY_MAP_H

#define ANATOP_IPS_BASE_ADDR 0x020c8000

#define ADC1_BASE_ADDR 0x02198000
#define ADC2_BASE_ADDR 0x0219c000
#define APBH_BASE_ADDR 0x01804000
#define ASRC_BASE_ADDR 0x02034000
#define BCH_BASE_ADDR 0x01808000
#define CCM_BASE_ADDR 0x020c4000
#define CCM_ANALOG_BASE_ADDR 0x020c8000
#define CSI_BASE_ADDR 0x021c4000
#define ECSPI1_BASE_ADDR 0x02008000
#define ECSPI2_BASE_ADDR 0x0200c000
#define ECSPI3_BASE_ADDR 0x02010000
#define ECSPI4_BASE_ADDR 0x02014000
#define EIM_BASE_ADDR 0x021b8000
#define EMVSIM1_BASE_ADDR 0x0218c000
#define EMVSIM2_BASE_ADDR 0x021b4000
#define ENET1_BASE_ADDR 0x02188000
#define ENET2_BASE_ADDR 0x020b4000
#define EPIT1_BASE_ADDR 0x020d0000
#define EPIT2_BASE_ADDR 0x020d4000
#define FLEXCAN1_BASE_ADDR 0x02090000
#define FLEXCAN2_BASE_ADDR 0x02094000
#define GPC_BASE_ADDR 0x020dc000
#define GPIO1_BASE_ADDR 0x0209c000
#define GPIO2_BASE_ADDR 0x020a0000
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#define GPIO5_BASE_ADDR 0x020ac000
#define GPMI_BASE_ADDR 0x01806000
#define GPT1_BASE_ADDR 0x02098000
#define GPT2_BASE_ADDR 0x020e8000
#define I2C1_BASE_ADDR 0x021a0000
#define I2C2_BASE_ADDR 0x021a4000
#define I2C3_BASE_ADDR 0x021a8000
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#define I2S2_BASE_ADDR 0x0202c000
#define I2S3_BASE_ADDR 0x02030000
#define IOMUXC_BASE_ADDR 0x020e0000
#define IOMUXC_GPR_BASE_ADDR 0x020e4000
#define KPP_BASE_ADDR 0x020b8000
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#define LCDIF2_BASE_ADDR 0x02224000
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#define OCOTP_BASE_ADDR 0x021bc000
#define PMU_BASE_ADDR 0x020c8000
#define PWM1_BASE_ADDR 0x02080000
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#define PXP_BASE_ADDR 0x021cc000
#define QUADSPI_BASE_ADDR 0x021e0000
#define ROMC_BASE_ADDR 0x021ac000
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#define SDMABP_BASE_ADDR 0x020ec000
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#define UART1_BASE_ADDR 0x02020000
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#define UART8_BASE_ADDR 0x02024000
#define USB_BASE_ADDR 0x02184000
#define USBNC_BASE_ADDR 0x02184000
#define USBPHY1_BASE_ADDR 0x020c9000
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#define USDHC1_BASE_ADDR 0x02190000
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#define WDOG1_BASE_ADDR 0x020bc000
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#define XTALOSC24M_BASE_ADDR 0x020c8000

#define USB_UOG1_BASE_ADDR USB_BASE_ADDR
#define USB_UOG2_BASE_ADDR (USB_BASE_ADDR+0x200)

#define CCM_ANALOG_PLL_USB1n (CCM_ANALOG_BASE_ADDR+0x10)
#define CCM_ANALOG_PFD_528n (CCM_ANALOG_BASE_ADDR+0x100)

#define CAN0_BASE_ADDR FLEXCAN1_BASE_ADDR
#define CAN1_BASE_ADDR FLEXCAN2_BASE_ADDR
#define CSD0_BASE_ADDR 0x80000000

#define MMDC_P0_BASE_ADDR MMDC_BASE_ADDR


#endif //_SOC_MEMORY_MAP_H